FPGA 學習之路：verilog學習第5天
最近一直在出差，沒時間學，這兩天補上，之前的modelsim的模擬波形一直出不來，原來是沒有寫testbench中加入激勵，百度網上的這塊的模擬資料，終於用了兩天把波形仿出來了，雖然是很簡單的一個三個與門的綜合，也算是又學習了一點點了。
接下來的學習計劃是開始做一個LED的流水燈。也會把進展一起貼出來。
希望在3個月左右的時間，熟悉Quartus 和verilog。
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